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模拟集成电路设计系列博客——8.4.1 全数字锁相环介绍
8.4.1 全数字锁相环介绍 随着CMOS工艺的演进,数字电路的尺寸得到不断的微缩,工作电压不断的降低,这使得模拟PLL受到了许多挑战,如环路滤波器中无源器件尺寸庞大,即使在更先进的CMOS工艺下也无法缩小,如果改为片外器件又会引入额外噪声,并增加pad需求和PCB面积,如下图所示,一个典型的模拟P
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2024-07-03 16:46
sasasatori
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